가산기/ 감산기/ 플립플롭
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작성일 22-11-07 10:50
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다음은 effect적인 논리 합성을 위하여 설계를 타이머와 제어 장치로 분할한다. 분할된 각 블록은 논리 합성이 가능한 behavioral기술로서 모델링되어 시물레이션을 거친 다음 합성된다 합성된 회로의 동작은 VHDL netlist를 이용하여 검증하며, 전체 TLC의 모델은 두 하위 레벨 블록을 事例화하여 구조적으로 기술되며 논리 합성을 한다. 신호의 상태는 남북(이하 NS), 동서(이하 EW)로 표시하고, 신호의 상태는 NS - EW 의 신호로 표시한 다.
NS_R
NS_G
NS_G
EW_R
EW_Y
EW_G
Constant
1
0
0
0
0
1
red-green
1
0
0
0
1
0
red-yellow
0
0
1
1
0
0
green-red
0
1
0
1
0
0
yellow-red
신호등 제어 신호 값
위의 그림은 TLC를 하향 지향식 설계 방식으로 VHDL 모델링하여 설계하는 흐름도를 보여준다.
Library ieee; -- 라이브러리 선언부
Use ieee.std_logic_1164.all;
Use ieee.std_logic_unsigned.all;
entity traffic is -- I/O 선언부 input : clock …(투비컨티뉴드 )
[가산기][감산기][플립플롭]
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설명
레포트/공학기술
다.
다.
나. 교통 신호 제어기(TLC)는 외부 클럭 신호만 인가해주면 동작하는 회로이다. 처음에는 TLC전체를 보다 추상적인 behavioral기술 방법을 이용하여 모델링한다. 예를 들어 NS방향이 red 이고 EW방향이 green 이면 red-green 으로 신호의 상태를 표시.
라. red-green 신호가 5클럭을 유지하고, 한 클럭의 red-yellow, 그리고 5클럭의 green-red 가 유지된다
마. 간선 도로의 신호등이 녹색으로 바뀐 뒤 적어도 일정시간(long_duration)동안은 녹색을 유지한다.
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가산기/ 감산기/ 플립플롭
1. 교통 신호 제어기(TLC)의 개요
2. 하위 레벨 constituent 의 VHDL모델링
3. 교통신호 제어 흐름도
가. 동시 신호의 3색등으로 구성되어 있어 남북방향의 신호등은 같은 신호를 가진다.
